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Gehäuse
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Logik - Typ
Anzahl der Schaltkreise
Strom - Ausgang, HIGH/LOW
Spannung - Versorgung
Betriebstemperatur
Montagetyp
Gehäuse / Hülle
Gehäusetyp vom Lieferanten
14-SOIC-SOT108-1
74HCT280D,653
IC PARITY GEN/CHKER 9-BIT 14SO
Nexperia USA Inc.
7.490
Vorrätig
1 : 0,90000 €
Gurtabschnitt (CT)
2.500 : 0,38750 €
Gurt auf Rolle (Tape and Reel - TR)
Gurt auf Rolle (Tape and Reel - TR)
Gurtabschnitt (CT)
Digi-Reel®
AktivParity-Generator/Checker9-Bit-4.5 V ~ 5.5 V-Oberflächenmontage14-SOIC (0,154", 3,90mm Breite)14-SO
14-SOIC-SOT108-1
74HCT280D,652
IC PARITY GEN/CHKER 9-BIT 14SO
Nexperia USA Inc.
0
Vorrätig
Obsolet
Lose im Beutel
Lose im Beutel
Lose im Beutel
ObsoletParity-Generator/Checker9-Bit-4.5 V ~ 5.5 V-Oberflächenmontage14-SOIC (0,154", 3,90mm Breite)14-SO
OPA4137P
CD74HCT280E
IC PARITY GEN/CHKER 9-BIT 14DIP
Harris Corporation
7.705
Marktplatz
889 : 0,33334 €
Stange
Stange
ObsoletParity-Generator/Checker9-Bit4mA, 4mA4.5 V ~ 5.5 V-55°C bis 125°CDurchkontaktierung14-DIP (0,300", 7,62mm)14-PDIP
14-DIP
CD74HCT280E
IC PARITY GEN/CHKER 9-BIT 14DIP
Texas Instruments
858
Vorrätig
7.650
Factory
1 : 0,89000 €
Stange
Stange
AktivParity-Generator/Checker9-Bit4mA, 4mA4.5 V ~ 5.5 V-55°C bis 125°CDurchkontaktierung14-DIP (0,300", 7,62mm)14-PDIP
14-SSOP_SOT337-1 pkg
74HCT280DB,112
IC PARITY GEN/CHKER 9-BIT 14SSOP
Nexperia USA Inc.
0
Vorrätig
Obsolet
Stange
ObsoletParity-Generator/Checker9-Bit-4.5 V ~ 5.5 V-Oberflächenmontage14-SSOP (0,209", 5,30mm Breite)14-SSOP
14-SSOP_SOT337-1 pkg
74HCT280DB,118
IC PARITY GEN/CHKER 9-BIT 14SSOP
Nexperia USA Inc.
0
Vorrätig
Obsolet
Gurt auf Rolle (Tape and Reel - TR)
ObsoletParity-Generator/Checker9-Bit-4.5 V ~ 5.5 V-Oberflächenmontage14-SSOP (0,209", 5,30mm Breite)14-SSOP
14-DIP
74HCT280N,652
IC PARITY GEN/CHKER 9-BIT 14DIP
NXP USA Inc.
0
Vorrätig
Obsolet
Stange
ObsoletParity-Generator/Checker9-Bit-4.5 V ~ 5.5 V-Durchkontaktierung14-DIP (0,300", 7,62mm)14-DIP
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Logik - Paritätsgeneratoren und -prüfer


Die Bausteine aus der Familie der Paritätsgeneratoren- und -prüfer sind Komponenten, die dazu eingesetzt werden, die Anzahl der Bits in einem digitalen Wort zu evaluieren, die auf 1 gesetzt sind, und um ein zusätzliches Paritäts-Bit zu erzeugen (oder zu evaluieren). Dieses Paritäts-Bit gibt an, ob die Anzahl der auf 1 gesetzten Bits in dem Wort gerade oder ungerade ist. Diese Funktion wird üblicherweise als einfache Erkennungsmethode für Datenfehler genutzt, die bei der Übertragung entstanden sein können.